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8V19N490BBDGI是一款完全集成的FemtoClock? NG抖動衰減器和時鐘頻率合成器，設(shè)計用作無線基站無線電設(shè)備板的調(diào)理和頻率/相位管理的高性能時鐘解決方案。

該抖動衰減器主要包括以下特點：

支持JESD204B的高性能時鐘RF-PLL

針對低相位噪聲進行了優(yōu)化:-150dBc/Hz (800kHz偏移；245.76MHz時鐘)

積分相位噪聲典型值為52fs RMS(12 khz至20MHz)

雙PLL架構(gòu)

第一個PLL級內(nèi)置外部VCXO，用于時鐘抖動衰減

第二個PLL內(nèi)置飛秒NG PLL: 2949.12MHz

對于3932.16MHz:參見8V19N492-39

對于3686.4MHz:參見8V19N491-36

對于2457.6MHz:參見8V19N490-24和8V19N491-24

對于1966.08MHz:參見8V19N490-19

六個輸出通道，共19個輸出，組織為:

四個JESD204B通道(器件時鐘和SYSREF輸出),具有兩路、四路和六路輸出

一個時鐘通道有兩個輸出

一路VCXO輸出

可配置整數(shù)時鐘分頻器

支持的時鐘輸出頻率包括:2949.12、1474.56、983.04、491.52、245.76、122.88

低功耗LVPECL/LVDS輸出支持可配置的信號幅度、DC和交流耦合，以及LVPECL、LVDS線路端接技術(shù)

相位延遲電路:

時鐘相位延遲，256步，339ps，范圍0至86.466ns

獨立SYSREF相位延遲，8步169ps

額外的獨立SYSREF精密相位延遲，25ps步進

全局SYSREF信號延遲，256步，339ps，范圍0至86.466ns

具有四路輸入的冗余輸入時鐘架構(gòu)，包括:

輸入活動監(jiān)控

手動和自動、故障觸發(fā)時鐘選擇模式

優(yōu)先級控制時鐘選擇

數(shù)字保持和無中斷開關(guān)

差分輸入接受LVDS和LVPECL信號

SYSREF產(chǎn)生模式包括JESD204B的內(nèi)部和外部觸發(fā)模式

電源電壓:3.3V

SPI和控制I/O電壓:1.8V/3.3V(可選)

封裝：11mm x 11mm 100-CABGA

8V19N490BBDGI經(jīng)過優(yōu)化，可提供GSM、WCDMA、LTE和LTE-A無線電板實施所需的出色相位噪聲性能。8V19N490B支持JESD204B子類0和1時鐘。

典型應(yīng)用

? 無線基礎(chǔ)設(shè)施應(yīng)用：GSM、WCDMA、LTE、LTE-A

? 適用于抖動敏感型 ADC 和 DAC 電路的理想時鐘驅(qū)動器

? 低相位噪聲時鐘生成

? 以太網(wǎng)線卡

? 雷達和成像

? 儀器儀表和醫(yī)療

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